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  触发器结合的同步二进制加以法计数器

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  触发器结合的同步二进制加以法计数器

  采取VHDL言语设计壹个4位二进制计数器74163,它具拥有同步清洞、同步置数、计数把持和进位输入把持干用。如次图所示。

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  4位二进制计数器74163

  CLK:时钟记号,上升沿计数;

  CLRL:同步清洞端,低电平拥有效;

  LDL:同步置位把持端,低电平拥有效;

  ENP:与ENT同时为‘1’时,计数使能;

  ENT:为‘1’时,却终止进位;

  D[3..0]:计数器置数输入;

  Q[3..0]:计数器样儿子输入;

  RCO:计数器进位输入。

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  用触发器结合计数器。触发器拥有0 和1两种样儿子,故此用壹个触发器就却以体即兴壹位二进制数。假设把n个触发器串宗到来,就却以体即兴n位二进制数。关于什进制计数器,它的10个数码要寻求拥有10个样儿子,要用4位二进制数到来结合。下图是由D触发器结合的4位异步二进制加以法计数器。

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  1、将芯片(1)的伸脚丫儿子4、10包到壹道,

  2、将芯片(2)的伸脚丫儿子4、10包到壹道,

  3、将芯片(1)的伸脚丫儿子10和芯片(2)的伸脚丫儿子10包到壹道,

  4、将芯片(1)的伸脚丫儿子10包到+5V;

  5、将芯片(1)的伸脚丫儿子1、13包到壹道,

  6、将芯片(2)的伸脚丫儿子1、13包到壹道,

  7、将芯片(1)的伸脚丫儿子13和芯片(2)的伸脚丫儿子13包到壹道,

  8、将芯片(1)的伸脚丫儿子13包到+5V;

  9、将芯片(1)的伸脚丫儿子3接届期钟记号CP

  10、将芯片(1)的伸脚丫儿子2、6接到壹道,又将伸脚丫儿子2接到伸脚丫儿子11

  11、将芯片(1)的伸脚丫儿子8、12接到壹道,又将芯片(1)的伸脚丫儿子8接到芯片(2)的伸脚丫儿子3

  12、将芯片(2)的伸脚丫儿子2、6接到壹道,又将伸脚丫儿子6接到伸脚丫儿子11

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